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- Опубліковано 14 січ 2025
- Je me lance dans la programmation d'un FPGA! Cinquième partie, je conçois un fréquencemètre à 8 chiffres LED. Je le créé en code source Verilog. Je fais ensuite les essais de performance.
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Merci Bertrand ! Cette série est vraiment fabuleuse, t'as réussi à montrer simplement le fonctionnement et l'intérêt des languages HDL.
Je vois que vous êtes devenu un maître et expert dans ce circuit intégré bravo pour vos émissions et un grand merci
Magnifique ! Cette démystification du langage et cette application pratique donnent le goût de ce mettre à l'étude. Bertrand, j'ai hâte de voir ton petit circuit de conversion à TTL, sujet auquel je suis confronté avec la normalisation des sorties du SI5351 que tu as présenté il y a quelques mois. Merci encore de partager ainsi ta connaissance. R.J.
Bravo ! Comme petite bidouille sur une plaquette d'évaluation vous avez réalisé un appareil de mesure plus performant que bien des fréquencemètres !
Merci bien pour votre effort cher prof
Bonjour, video très intéressante et explications claires , merci ! je ne connaissais pas l'algorithme "double dabble" assez astucieux. Voici plus de 30 ans, j'avais aussi dû convertir du binaire en BCD dans un programme écrit en assembleur 6809 mais juste en comptant les puissances décroissantes de 10 par soustractions successives (6 chiffres décimaux nécessitant au pire 5*9 = 45 soustractions)
Bravo Bertrand ! 👍👍👍
Je suis impatient de voir la suite !
good job Bertrand , bonne continuation
Très bonne vidéo. Merci Bertrand.
Super petite bidouille . Je ne connaissais pas les FPGA. Je suis moins bête ce soir ! Bye
J'en connais un autre :-)
Je ne connaissais pas du tout le fonctionnement de ces puces.
Merci Bertrand
good job mon ami, ça me donne envie de commander un kit FPGA ;)
Bonjour, Merci pour cette vidéo très très constructive, et merci pour votre immense travail et partage de connaissances.
Ce que je n'ai pas compris est: Comment est géré le signal d'entrée, ou autrement dit, par quoi est cadencé le compteur 28 bits d'entrée ?
D'après ce que j'ai compris ce compteur de 28bit "par construction" peut compter jusqu'à un peu plus de 268 MHz, qu'en est il si on lui en affecte 32, il pourrait mesurer jusqu'à plus de 4 GHz ?
Je bloque sur ce compteur qui je pense est un registre à décalage circulaire, pour effectuer ce décalage il y a bien un temps de réponse ou une vitesse limite au delà de laquelle le compteur ne voit plus rien ? Comme un registre TTL ou CMOS classique, il doit bien y avoir une fréquence maxi de fonctionnement ? Est-elle définie dans la datasheet du FPGA ?
J'aimerai bien comprendre comment est implémenté "Physiquement" ce compteur en interne du FPGA...
Merci d'avance si jamais vous pouviez me transmettre votre compréhension. Désolé de déterrer peut-être un sujet ancien à vos yeux, mais je suis curieux :)
Assez impressionné par la performance de ce FPGA qui, de plus, était seulement d'entrée de gamme dans cette série.
La robustesse du code y est aussi probablement pour beaucoup ^^
Ca donnerait presque envie de s'y mettre :-)
vraiment bien cette plaquette FPGA !
Superbe vidéo ! On pourrai envisager un générateur de signaux alors ?
Ça y est, je suis captivé par l’utilisation d’un FPGA !
J’attends donc la suite avec impatience comme d’habitude.
Pour revenir sur cet épisode et les améliorations possibles, j’aimerais bien connaitre comment capter le « 10 MHz GPS » pour en faire l’horloge de référence car il semble que ce soit le point faible de la carte.
Bravo d’avance pour les prochaines vidéos ; la sauvegarde flash me plait beaucoup.
Ah, j’oubliais, merci pour cette série...et pour les autres aussi.
Merci bien
Merci prof ,reste une question :comment programme cette puce en dehors de cette carte pour l' utilisation Dans des projets.
Elle ne se développe pas "en dehors" d'un projet, mais bien déjà montée sur la plaquette de notre projet.
Excusez Monsieur Bertrand quel est nom du logiciel utilisé pour l'explication
J'ai fait le dessin en ligne sur Google Disque, rien de plus.
Si j'ai bien compris chaque bloc du schéma défini chaque bloque de code ? Mais comment le programme relie les entrée et sortie des différents bloc ?
N'y a t'il pas des variables qui sont utilisées dans plus d'un bloc?...
Oui effectivement, j'ai difficile à appréhender ce genre de code !
Car je suis vraiment habitué à du séquentiel.
Merci beaucoup
Développement ultérieur
Là c'est de la super bidouille !!!!
Pourquoi ne pas, à chaque front haut de l'horloge 1Hz, stocker dans un registre la valeur du compteur 28 bit et remettre ce dernier à zéro?
Ce que je fais garantit qu'il n'y aura aucune impulsion de manquée sur le compteur d'entrée. C'est l'approche privilégiée en software. Mais en effet, fort probable que ce serait OK dans un FPGA, même à plus de 100 MHz. Donc, mauvaise influence de mon expérience software!
la conversion du compteur 32 bits en BCD me semble fausse. Vous transformez des blocs de 4 bits qui sont en binaire pur vers des chiffres en BCD.
Je pense qu'il faudrait faire une suite de division par 10 du compteur 32 bits ....
les 4 bits du compteur peuvent varier de 0x0 à 0xF et non de 0 à 9
Edit: je retire, je n'avais pas encore regardé jusqu'au bout ..... le listing Mea culpa !
;-)
j'aime beaucoup vos explications, mais la musique me tape sur les nerfs
J'ai beaucoup baissé le niveau de la musique depuis.
c'est pas violet mais lilas ;o)
mieux encore lavande
Bof!
Moi je dirai plutôt mauve...